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2. S. Cui, M. J. Liebelt, and K. Eshraghian. Using unified technology to implement a solid modelling accelerator: project report I. CHiPTec Tech. Rep. GaAs-93-09, The University of Adelaide, July 1993.



3. E. Chu, S. Cui, and A. R. Moini. The pseudo-current-mode logic familt (PCML). CHiPTec Tech. Rep. GaAs-92-06, The University of Adelaide, April 1992.



4. S. Cui, E. Chu, and A. R. Moini. Source follower FET logic (SFFL). CHiPTec Tech. Rep. GaAs-92-07, The University of Adelaide, May 1992.



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6. D. Abbott, S. Cui, K. Eshraghian, and E. McCabe. Photovoltaic gate biasing edge effect in GaAs MESFETs. CHiPTec Tech. Rep. GaAs-91-11, The University of Adelaide, June 1991.

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